Debug-Zyklus um 40 % verkürzt, Synopsys AI-Design-Tool vorgestellt

Synopsys hat zwei Arten von Halbleiter-Design-Workflows vorgestellt. In der ersten Bewertung des Debug-Workflows wurde der Arbeitszyklus um 25 bis 40 % verkürzt. Am 27. Juli 2026 wurden auf der DAC die auf Microsoft Discovery basierenden Workflows "Debug Closer" und "Implementation and Closer" vorgestellt. Beide Workflows nutzen Agent-Engineer-Technologie. Der autonome Workflow führt Aufgaben wie Planung, Validierung, Ursachenanalyse und Qualitätsanpassung durch. Der Debug Closer-Workflow automatisiert die Designvalidierung und Fehleranalyse, wobei der Debug-Zyklus in der ersten Bewertung um 25 bis 40 % verkürzt wurde. Der Implementation and Closer-Workflow betreibt Synopsys' Implementierungsagenten und Fusion Compiler auf Azure. Der Closer-Prozess ist der Vorgang, bei dem die Ergebnisse angepasst werden, um mehrere Ziele wie Leistung, Stromverbrauch, Fläche und Timing zu erfüllen. AMD bewertet die Anwendbarkeit dieses Workflows, während Microsoft angekündigt hat, dass es virtuelle Maschinen auf Basis der 6. Generation von AMD EPYC und Azure HXv2 für das Halbleiterdesign hinzufügen wird. Diese Ankündigung ist ein Beispiel dafür, wie der Automatisierungsbereich von der Frontend-Entwicklung auf die Debug- und Implementierungsphasen ausgeweitet wird. Die Produktivitätszahlen von Synopsys bleiben in der ersten Bewertung, und der tatsächliche Implementierungsbereich sowie die Leistung werden im Kundenbewertungsprozess validiert.

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